- 全球电子设计创新领先企业Cadence设计系统公司 (NASDAQ: CDNS)，日前宣布与灿芯半导体共同合作，将Cadence DDR Soft DLL PHY IP应用于中芯国际集成电路制造有限公司(SMIC)生产工艺的设计体系。
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Cadence 灿芯 存储器
- 灿芯半导体日前宣布，开始面向客户提供能满足快速和可靠的RTL交付的新一代SoC集成平台“Briliante”。根据客户定制的目标，结合架构的复杂度，灿芯半导体能在1~3天内完成RTL设计以供综合，包括自动生成测试案例以供验证。此外，这个通用的平台可以杜绝手工连接所带来的风险，能通过简单的、参数化的配置实施编程。
“Briliante”平台不仅能通过AMBA AHB和APB的ARM标准总线来把基于ARM CortexTM-M0, Cortex-M3
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灿芯 SoC
- 国际领先的IC设计及一站式服务供应商 — 灿芯半导体(上海)有限公司(以下简称“灿芯半导体”)日前宣布，开始面向客户提供能满足快速和可靠的RTL交付的新一代SoC集成平台“Briliante”。根据客户定制的目标，结合架构的复杂度，灿芯半导体能在1~3天内完成RTL设计以供综合，包括自动生成测试案例以供验证。此外，这个通用的平台可以杜绝手工连接所带来的风险，能通过简单的、参数化的配置实施编程。
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灿芯 SoC Briliante
- 中芯国际集成电路制造有限公司(“中芯国际”，纽约证券交易所：SMI，香港联合交易所：0981.HK)和国际领先的IC设计公司及一站式服务供应商 -- 灿芯半导体(上海)有限公司(以下简称“灿芯半导体”)及浙江大学集成电路与基础软件研究院日前宣布，(以下简称“浙大”)共同创办IC研究合作实验室。
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中芯国际 灿芯 半导体
- 国际领先的IC设计及一站式服务供应商—灿芯半导体(上海)有限公司(以下简称“灿芯半导体”)日前宣布，灿芯半导体的台湾分公司和美国分公司已正式成立。
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灿芯 半导体
- 国际领先的IC设计公司及一站式服务供应商—灿芯半导体(上海)有限公司与中芯国际集成电路制造有限公司及ARM日前联合宣布，采用中芯国际40纳米低漏电工艺的ARM® Cortex™-A9 MPCore™双核测试芯片首次成功流片。
该测试芯片基于ARM Cortex-A9双核处理器设计，采用了中芯国际的40纳米低漏电工艺。处理器使用了一个集32K I-Cache和32K D-Cache，128 TLB entries，NEON™ 技术，以及包括调
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灿芯 测试芯片 Cortex
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