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流水线 文章 进入流水线技术社区

ARM体系结构之:流水线

  • 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
  • 关键字: 流水线  指令译码器  ARM  

新型流水线实现高速低功耗ADC的原理及方法

  • 1 MAX1200的特点功能  新型ADC正在朝着低功耗、高速、高分辨率的方向发展,新型流水线结构正是实现高速低 ...
  • 关键字: 流水线  高速  低功耗  ADC  

13bit 40MS/s流水线ADC中的采样保持电路设计

  • 本文对流水线ADC的采样保持电路的结构以及主要模块如增益提高型运算放大器电路、共模反馈电路和开关电路进 ...
  • 关键字: 13bit  流水线  ADC  采样  保持电路  

用于低噪声CMOS图像传感器的流水线ADC设计及其成像验证

  • 摘要:在对低噪声CMOS图像传感器的研究中,除需关注其噪声外,目前数字化也是它的一个重要的研究和设计方向,设计了一种可用于低噪声CMOS图像传感器的12 bit,10 Msps的流水线型ADC,并基于0.5mu;m标准CMOS工艺进行
  • 关键字: ADC  设计  及其  验证  流水线  传感器  噪声  CMOS  图像  用于  

一种固定1024点流水线FFT处理器结构研究

  • 快速傅里叶变换(FFT)算法实现的流水线结构FFT处理器在实时专用处理器中得到了广泛应用.Bi和Jones提出一种固定1024点流水线FFT处理器结构,该结构在运算的每级只采用一个复数乘法器.基于此结构Hasan设计了一种能够进行
  • 关键字: 1024  FFT  流水线  处理器    

一种可重构流水线ADC的设计

  • 摘要:对多标准无线通信系统中的A/D转换器进行了研究,根据无线通信系统的特点,构建了一个新型可重构流水线A/D转换器结构,该A/D转换器的可重构功能是通过在低分辨率下关断子级流水线来实现的。转换器的系统指标
  • 关键字: 设计  ADC  流水线  重构  

流水线ADC的行为级仿真

  • 摘要:行为级仿真是提高流水线(pipeline)ADC设计效率的重要手段。建立精确的行为级模型是进行行为级仿真的关键。本文采用基于电路宏模型技术的运算放大器模型,构建了流水线ADC的行为级模型并进行仿真。为验证提出模
  • 关键字: 仿真  行为  ADC  流水线  

基于流水线及混合滤波技术的H.264去块效应模块设

  • 引 言图像的编解码技术是多媒体技术的关键,H.264/AVC是国际上最先进的视频压缩技术,其主要特点是采用小尺寸整数余弦变换、1/4像素的运动估计精度、多参考帧预测,基于上下文可变长度编码和环路内去块效应滤波器
  • 关键字: 264  流水线  滤波技术  效应    

基于FPGA的高速流水线浮点乘法器设计与实现

  • 1 引言  在数字化飞速发展的今天,人们对微处理器的性能要求也越来越高。作为衡量微处理器 性能的主要标准,主频和乘法器运行一次乘法的周期息息相关。因此,为了进一步提高微处 理器性能,开发高速高精度的乘法器
  • 关键字: FPGA  流水线  浮点  乘法器设计    

固定1024点流水线FFT处理器研究

  • 快速傅里叶变换(FFT)算法实现的流水线结构FFT处理器在实时专用处理器中得到了广泛应用.Bi和Jones提出一种固定1024点流水线FFT处理器结构,该结构在运算的每级只采用一个复数乘法器.基于此结构Hasan设计了一种能够进行
  • 关键字: 1024  FFT  流水线  处理器    

一种12位50 MS/s CMOS流水线A/D转换器

  • 摘要:采用TSMC 0.18 mu;m 1P6M工艺设计了一个12位50 MS/s流水线A/D转换器(ADC)。为了减小失真和降低功耗,该ADC利用余量增益放大电路(MDAC)内建的采样保持功能,去掉了传统的前端采样保持电路,采用时间常数匹配
  • 关键字: 流水线  转换器  CMOS  MS  12位  一种  

流水线处理技术在数据集成中的应用

  • 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
  • 关键字: 数据集成  流水线  内存控制  

电子产品流水线自动送板机设计

  • 本文给出了电子产品流水线上使用的自动送板机设计方案。描述了硬件系统和软件系统,通过测试表明,该系统能够完成对电子产品流水线上自动贴片机/插装机的自动送板。可有效提高生产效率,降低工人劳动强度。
  • 关键字: 设计  自动  流水线  电子产品  

适用于12 bit流水线ADC采样保持电路的设计

  • 本文设计了一个可用于12 bit,20 MS/s流水线ADC中的采样/保持电路。该电路使用CSMC公司的0.5μm CMOS工艺库,在20 MS/s采样频率下,当输入信号的频率为9.8193 MHz时,SFDR为76 dB,精度达0.012%,完全满足12 bit要求。本文运用增益增强型折叠式运算放大器,以获得较高的增益和带宽。同时采用栅压自举开关,并通过对电路中的开关组合优化,极大的提高了电路的线性性能;采用全差分结构、底极板采样来消除电荷注入和时钟馈通。该采样保持电路能够直接应用于高速高精度模/数转换
  • 关键字: 保持  电路  设计  采样  ADC  bit  流水线  适用于  

高速流水线浮点加法器的FPGA实现

  • 本工程设计完全符合IP核设计的规范流程,而且完成了Verilog HDL建模、功能仿真、综合、时序仿真等IP核设计的整个过程,电路功能正确。实际上,本系统在布局布线后,其系统的最高时钟频率可达80MHz。虽然使用浮点数会导致舍入误差,但这种误差很小,可以忽略。实践证明,本工程利用流水线结构,方便地实现了高速、连续、大数据量浮点数的加法运算,而且设计结构合理,性能优异,可以应用在高速信号处理系统中。
  • 关键字: FPGA  流水线  浮点  加法器    
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