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压控振荡器(vco) 文章 进入压控振荡器(vco)技术社区

ADI发布全新高性能电压控制振荡器系列

  • Analog Devices, Inc. (ADI),全球领先的高性能信号处理解决方案供应商,最近针对点对点(PtP)仪器仪表/测试设备和卫星通信应用,推出全新的微波IC系列产品——ADF55xx系列电压控制振荡器(VCO)。新型ADF55xx VCO系列具有业界领先的相位噪声性能,工作频率范围涵盖3.5 GHz至13.9 GHz,提供宽调频范围,是ADI先进的PLL频率合成器产品组合的补充。
  • 关键字: ADI  振荡器  ADF55xx  VCO  

打破调谐范围记录的串联LC储能VCO

  • 本例提出了一个新颖的振荡器结构。它使用一个串联LC(电感-电容)储能电路,使调谐范围大于采用并联LC方式的电路。这种振荡器结构能够获得宽的频率区间,明显超过最好的宽带调谐变容二极管性能。工程师们都认为现有水
  • 关键字: VCO  调谐  串联  储能    

良好电源设计有利于提升锁相环性能

  • 摘要:锁相环是现代通信系统的基本构建模块,而电源噪声越来越影响锁相环性能。本文通过列举多种电源管理电路设计的新方法,解析不同的设计对锁相环性能产生的影响。
  • 关键字: VCO  PLL  201209  

一种宽调频高频LC VCO的设计

  • 压控振荡器可分为环路振荡器和LC振荡器。环路振荡器易于集成,但其相位噪声性能比LC振荡器差。为了使相位噪声满足通信标准的要求,这里对负阻LC压控振荡器进行了分析,利用安捷伦公司的ADS软件设计了一款性能优异的压
  • 关键字: VCO  调频  高频    

一种基于锁相环的时钟系统设计

  • 本文介绍了一种基于CMOS工艺的高性能处理器时钟系统设计,设计频率为200MHz,VCO的相位噪声为-110dBC/Hz@100kHz ...
  • 关键字: 锁相环  时钟系统  压控振荡器  

压控振荡器(VCO)的设计

  • 压控振荡器(以下简称VCO)已经成为当今无线收发器系统中不可缺少的模块, 它是锁相环中最重要的block, 他的噪声性能直接决定了PLL输出相位噪声的噪声性能. 有关PLL整体的分析和设计, 我们将在后期重点讨论. 这里先重点
  • 关键字: 设计  VCO  振荡器  

PLL-VCO制作方法介绍

  • 在此说明以晶体振荡器做为基准振荡器,将其与VCO以及PLL电路组合成为信号产生器的情形也被称为频率合成器。
    此一PLL-VCO电路的设计规格如表l所示。振荡频率范围为40M~60MHz内的10MHz宽。每一频率阶段(step)宽幅为10
  • 关键字: PLL-VCO  方法    

50~150MHZ高频VCO电路功能及工作原理

  • 电路的功能本电路是50~150MHZ高频电压控制振荡器,可在通信机、信号发生器等高频电路中与PLL电路配合使用。若在控制电压端加4~5V的直流置偏,使话音等信号在这里加权,则可作为FM调制器使用。电路工作原理本电路是高
  • 关键字: 工作  原理  功能  电路  高频  VCO  150MHZ  

频率为3~30MHZ的高频VCO电路功能及工作原理

  • 电路的功能这是一种可在3M~30MHZ频率使用的电压控制振荡器,在通信机或信号发生器等测量仪器中,可与PLL电路配合使用。振荡回路采用了变形克拉着振荡电路方式,晶体管TR1的参数变动对振荡频率影响不大。电路工作原理
  • 关键字: 功能  工作  原理  电路  VCO  30MHZ  高频  频率  

利用低噪声LDO调节器ADP150为ADF4350 PLL和VCO供电

  • 电路功能与优势本电路利用低噪声、低压差(LDO)线性调节器为宽带集成PLL和VCO供电。宽带压控振荡器(VCO)可能对电源噪声较为敏感,因此,为实现最佳性能,建议使用超低噪声调节器。图1所示电路使用完全集成的小数N分
  • 关键字: PLL  VCO  供电  ADF4350  ADP150  噪声  LDO  调节器  利用  

射频电路设计中压控振荡器的应用

  • 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
  • 关键字: 压控振荡器  射频  通信电路  buffer  

信号链基础知识#54谁是音频时钟的“老板”,谁是主,谁是从呢

锁相环(PLL)的电源管理设计

  • 本文讨论图1所示的基本PLL方案,并考察每个构建模块的电源管理要求。图1.显示各种电源管理要...
  • 关键字: 电源管理  VCO  LDO  滤波    

高压VCO的一些替代方案

  • 引言  锁相环(PLL: Phase-locked loops)是一种利用反馈控制原理实现的频率及相位的同步技术,其作用是将电路输出的时钟与其外部的参考时钟保持同步。随着集成电路加工中功能器件的尺寸缩小,器件电源电压也呈下降
  • 关键字: VCO  方案    
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