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卷积码 文章

802.11b中卷积码和Viterbi译码的FPGA设计实现

  • 卷积码是一种重要的信道纠错编码方式,其纠错性能通常优于分组码,目前(2,1,6)卷积码已广泛应用于无线通信系统中,Viterbi译码算法能最大限度地发挥卷积码的纠错性能。阐述了802.11b中卷积码的编码及其Viterbi译码方法,给出了编译码器的设计方法,并利用Verilog HDL硬件描述语言完成编译码器的FPGA实现。使用逻辑分析仪,在EP2C5T144C8芯片上完成了编译码器的硬件调试。
  • 关键字: 卷积码  Viterbi译码  逻辑分析仪  

基于System View的比特误码率测试的仿真

  • 摘要:比特误码率(RBE)是衡量一个通信系统优劣的重要指标之一。对如何利用SystemView仿真软件测试和生成一个...
  • 关键字: 比特误码率  SystemView  BCH码  卷积码  

基于FPGA的卷积码编译码器

  • 摘要:基于卷积码的编译码原理,使用VHDL语言和FPGA芯片设计并实现了(2,1,3)卷积码编译码器。其中译码器设计采用“截尾”的Vite-rbi译码算法,在支路量度计算、路径量度和译码路径的更新与存储以及判决与
  • 关键字: FPGA  卷积码  编译码器    

LTE中卷积码的译码器设计与FPGA实现

  • 摘要:基于长期演进(LTE)的Tail-biting卷积码,介绍了维特比译码算法,它是一种最优的卷积码译码算法。由于Tail-biting卷积码的循环特性,采用固定延迟译码的方法,降低了译码复杂度。通过使用全并行的结构及简单的回
  • 关键字: FPGA  LTE  卷积码  译码器    

基于FPGA的卷积码的编/译码器设计

  • 卷积码是Elias在1955年最早提出的,稍后,Wozencraft在1957年提出了一种有效译码方法,即序列译码。Massey在1...
  • 关键字: FPGA  卷积码  维特比  软件无线电  

卷积码+QPSK的中频调制解调系统的FPGA

  • 在无线数据传输中,由于信道中的噪声干扰,在接收端会引入一定的误码率(BitErrorRate,BER)。高质量的数据业...
  • 关键字: FPGA  误码  卷积码  调制解调  

基于CPLD的卷积码编解码器的设计

  • 本文阐述了卷积码编解码器的基本工作原理,在MAX+PLUS2软件平台上,给出了利用复杂可编程逻辑器件设计的(2,1,6)卷积码编解码器电路,并进行了编译和波形仿真。
  • 关键字: CPLD  卷积码  编解码器    
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卷积码介绍

在一个二进制分组码(n,k)当中,包含k个信息位,码组长度为n,每个码组的(n-k)个校验位仅与本码组的k个信息位有关,而与其它码组无关。为了达到一定的纠错能力和编码效率(=k/n),分组码的码组长度n通常都比较大。编译码时必须把整个信息码组存储起来,由此产生的延时随着n的增加而线性增加。   为了减少这个延迟,人们提出了各种解决方案,其中卷积码就是一种较好的信道编码方式。这种编码方式同样是把k [ 查看详细 ]

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