一种新型的正弦信号发生器的设计与实现

摘要：为精确地输出正弦波、调幅波、调频波、PSK、ASK等信号及保证信号的高可靠性，设计出一种新型的正弦信号发生器。该正弦信号发生器以可编程逻辑器件CPLD和单片机AT89S52为基础，采用数字频率合成DDS技术实现频率合成功能，结合高速D/A器件AD9713使得输出频率维持在1 k~10 MHz范围内，步进为100 Hz，且通过对CPLD采用相应的数字控制算法实现调频FM，调幅AM和键控PSK、ASK数字调制功能。测试结果表明，设计的正弦信号发生器输出信号稳定度优于10-4，在频率范围内50 Ω的负载上输出正弦波电压幅度稳定在6±0.6 V，波形无明显失真，系统的整体性能良好。

　　0 引言

　　正弦信号源在实验室和电子工程设计中有着十分重要的作用，而传统的正弦信号源根据实际需要一般价格昂贵，低频输出时性能不好且不便于自动调节，工程实用性较差。本文的设计以较低的成本制作正弦信号发生器，可用作核磁共振中引发磁场测量仪的激励一般的正弦信号，也可作为调制用的教学演示信号源。

　　正弦信号发生器主要由两部分组成：正弦波信号发生器和产生调幅、调频、键控信号。正弦波信号发生器采用直接数字频率合成DDS技术，在CPLD上实现正弦信号查找表和地址扫描，经D／A输出可得到正弦信号。具有频率稳定度高，频率范围宽，容易实现频率步进100 Hz。全数字化结构便于集成，输出相位连续，频率、相位和幅度均可实现程控。

　　调幅、调频、键控信号的产生可采用调频、调幅专用芯片能分剐实现，但是该方法实现的调频调幅功能，对于某一特定频率和特定的调制度、频偏效果较好，在载波频率可变和调制度、频偏要求任意设定的情况下难以实现。本文利用CPLD和单片机AT89S52不仅可以实现频率范围可调的正弦波信号，而且在CPLD内部加上相应的数字控制算法就能方便地实现调频FM，调幅AM和键控PSK、ASK数字调制功能有利于提高系统的整体性能和工作可靠性。正弦信号产生部分可在一片CPLD(EP1K30)中实现，大大地简化了硬件电路，便于功能扩展，并为进一步实现系统集成创造了条件。

　　1 理论分析与计算

　　1．1 正弦波形的产生

　　单向DDS由Nbit相位累加器和ROM只读存储器(正弦查找表)构成的数控振荡源(NCO)，数模转换器(DAC)、低通平滑滤波器(LPF)构成，图1所示为DDS的基本结构。

　　图1中fc为时钟频率，K为频率控制字，N为相位累加器的字长，M为ROM地址线位数，L为ROM数据线宽度，fo为输出频率。相位累加器由全加器和累加寄存器级联组成。在时钟频率fc的控制下，对输入频率控制字K进行累加，累加满量时就产生溢出。相位累加器的输出对应于该时刻合成周期信号的相位，并且这个相位是周期性的，在0～2π范围内变化。相位累加器位数为N，最大输出为2N-1，对应于2π的相位，累加1次就输出1个相应的相位码，地址以查表方式，得到对应相位的信号幅度值，经过数模转换，就可以得到一定频率的信号输出波形，低通滤波器对输出的信号波形进行平滑处理，滤除杂波和谐波。由于控制字K经过2N／K次累加，相位累加器满量溢出，完成1个周期运算，所以输出频率fo由fc和K共同决定，即fo=fcK／2N且K2N-1，得到DDS的最小分辨率可达fc／2N。理论上通过设定DDS相位累加器的位数N、频率控制字K和时钟频率fc的值，就可以产生任一频率的输出。根据频率步进100Hz的要求，选取累加器的位数为19位，计算出时钟频率fc应为52．4288 MHz。步进的累计误差通过软件补偿的方法进行修正，利用现有的52．416 0 MHz晶振完全精确地实现步进100 Hz的要求。

图1 基于DDS的正弦信号发生器的原理图

　　1．2 产生模拟幅度调制信号

　　用调制信号去控制高频振荡的幅度，使其幅度的变化量随调制信号成正比地变化，这一过程称为幅度调制。若载波为uc=Uc cosωct，调制信号为f(t)=cosΩt，则调幅波为

　　普通调幅波利用模拟相乘器实现，但是外围电路复杂，改变调制度需改变电路元件的参数，实现起来繁琐。可以采用CPLD芯片结合DDS技术灵活的实现数字调幅，原理如图2所示。

图2 幅度调制原理图

　　由DDS产生的波形信号作为载波，在单片机内部作调制信号为1 kHz的正弦波形存储表，根据键盘所设定的调制度ma(10％～100％)与存储表中的数据相乘的结果送CPLD与DDS得到的波形相乘，再与DDS信号相加就产生相应的数字调幅波编码，经D／A转换得到模拟调幅信号。