60Hz时基信号发生器电路及其芯片介绍

上述两种电路适用于负极接地的整机电路，也适用于正极接地的电路系统，设计时可变通使用。

图4由两片CMOS集成电路、石英晶体构成的60Hz时钟电路。石英晶体和CD4060构成振荡、分频部分，BG1和CD4017构成计数、分配部分。在CD4060第5脚和第2脚分别输出1024Hz、4Hz的方波信号，1024Hz输入给CD4017第14脚作时钟脉冲，4Hz信号和分配给CD4017第11脚的信号组成“或门”信号再输入到CD4017第15脚作复位信号。在CD4017第2脚的1/4周期内，高电平时，CD4017复位；低电平时CD4017接收128个脉冲信号，9个脉冲信号CD4017复位一次，这样只分配给CD4017第2脚15个脉冲信号。在1秒内共分配给CD4017第2脚60个脉冲信号，从而得到实用时钟60Hz标准时基信号。

石英振荡频率的校正，可用频率计测量CD4060第9脚应为32768Hz，若偏离可微调整可变电容加以校正。

图5是由一片

CD4060构成的60Hz的时基信号发生器。相对前几种是最为实用的时基信号电路。