AVS解码器在DSP平台上的优化
每个模块在执行一个宏块行的解码过程中，会被反复执行N 次，在此期间程序代码保留在L1P中不被冲刷，直到第二个模块执行的时候第一个模块的代码才被冲刷。所以此方法解码一个宏块行才发生四次冲刷，完成一帧图像的解码共发生4 ×M 次代码冲刷，较改进之前减少冲刷次数4 ×M ×(N - 1)。
表1中的测试序列分辨率为720 ×576，调整结构后解码速率均有不同程度的提高，通过对统计结果的平均得知，效率提高20%左右。
表1 实验结果
3 结论
本文解码器优化充分利用了处理器的程序Cache功能，模块分配方式依据Cache大小而定，针对不同处理器的不同Cache， 可以有不同的模块划分方式，只需要保证每个模块代码量小于程序Cache容量即可。处理器对于数据的读取同样可以采用类似方法，以达到充分利用数据Cache的目的。此方法不仅可以应用于AVS解码器，也可应用于AVS编码器，还可以应用于与之拥有类似结构的H. 264、MPEG、VC1等编解码算法。
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